Xilinx Zynq搭建Vivado工程

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Vivado

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从零开始,搭建zynq-7000的PS硬件平台–DDR3接口集成与配置

颗粒的速度等级为多少,MT41K256M16TW,
Xilinx Zynq搭建Vivado工程DDR时钟533.33MHz,下面两组参数DQS to Clock Delay(ns)和Board Delay(ns)需要用PCB软件计算出来。DQS to Clock Delay(ns)参数范围-0.1~100,Board Delay(ns)参数范围0.007~100,
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