verilog RTL(4)

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参数化设计
verilog RTL(4)
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/************************************************************/
Latch锁存器(利用电平触发)
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/************************************************************/
Flip-Flops(利用边沿触发)
D触发器
异步复位:
always@(posedge clk or negedge reset)
if(!reset)
q<=1’b0;

同步复位:
always@(posedge clk)
if(!reset)
q<=1’b0;
/***********************************************************************************/
状态机FSM
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米利型
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摩尔型
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/*****************************************************************/
三段式fsm
第一段:状态跳转
第二段:跳转条件
第三段:状态输出

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/*****************************************************************/
阻塞赋值和非阻塞赋值
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