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    首页

    cyclone IV中DDR的一个疑惑

    2023-10-17 16:44:04

    的生成的DDR2 IP中DDR的时钟竟然是双向的，而在arria10中生成的DDR4则是输出，而DDR2的datasheet上也指出ck和ck#是输入，不知为什么？

    inout mem_clk ,
    inout mem_clk_n ,

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